Please use this identifier to cite or link to this item: http://ea.donntu.edu.ua:8080/jspui/handle/123456789/17300
Title: Оптимизация КМУУ с элементарными цепями
Authors: Баркалов, А.А.
Титаренко, Л.А.
Ефименко, К.Н.
Зеленёва, И.Я.
Keywords: КМУУ
ГСА
ЭОЛЦ
FPGA
логическая схема
ЕМВ
КМПК
ЕОЛЛ
логічна схема
CMCU
GSA
EOLC
logic circuit
Issue Date: 2012
Publisher: Донецький національний технічний університет
Series/Report no.: Наукові праці Донецького національного технічного університету;
Abstract: Предлагается метод уменьшения аппаратурных затрат в схеме КМУУ с элементарными цепями, ориентированный на технологию FPGA. Метод основан на использовании двух источников кодов классов псевдоэквивалентных ЭОЛЦ и мультиплексора, позволяющего выбрать один из этих источников. Такой подход позволит уменьшить число LUT элементов в схеме адресации КМУУ. Приведен пример применения предложенного метода. В роботі запропоновано метод зменшення апаратурних витрат у схемі КМПК із елементарними ланцюгами, який орієнтовано на технологію FPGA. Метод засновано на використанні двох джерел кодів класів псевдоеквівалентних ЕОЛЛ та мультіплексору, який дозволяє вибрати одне з цих джерел. Такій підхід дозволить зменшити число LUT елементів у схемі адресації КМПК. Наведено приклад використання запропонованого методу. A method for reducing the hardware amount in the circuit of CMCU with elementary chains is proposed oriented on FPGA technology. The method is based on the use of two sources of class codes of pseudoequivalent EOLC and a multiplexer, which allows choosing one of these sources. Such an approach would reduce the number of LUT elements in the addressing circuit of CMCU. An example of the proposed method application is given.
URI: http://ea.donntu.edu.ua/handle/123456789/17300
ISSN: 2074-7888
Appears in Collections:№1(10)-2(11),2012

Files in This Item:
File Description SizeFormat 
12baawec.pdf1,59 MBAdobe PDFView/Open


Items in DSpace are protected by copyright, with all rights reserved, unless otherwise indicated.